深入理解FPGA電子系統(tǒng)設(shè)計：基于Quartus Prime與VHDL的Altera FPGA

定　價：￥79.00

作　者：	李莉著
出版社：	清華大學(xué)出版社
叢編項：
標(biāo)　簽：	暫缺

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ISBN：	9787302534150	出版時間：	2020-03-01	包裝：	平裝
開本：	16	頁數(shù)：	296	字?jǐn)?shù)：

內(nèi)容簡介

　　本書分基礎(chǔ)與應(yīng)用兩部分，系統(tǒng)介紹了Altera FPGA的開發(fā)應(yīng)用知識。基礎(chǔ)部分包括FPGA開發(fā)流程、硬件描述語言VHDL、Quartus Prime設(shè)計開發(fā)環(huán)境、基本電路的VHDL設(shè)計、基于IP的設(shè)計等內(nèi)容；應(yīng)用部分包括人機交互接口設(shè)計、數(shù)字信號處理電路設(shè)計、密碼算法設(shè)計、基于Nios Ⅱ的SOPC系統(tǒng)開發(fā)等內(nèi)容，并在最后一章給出了24個常用設(shè)計實例。全書語言簡明易懂，邏輯清晰，向讀者提供了不同領(lǐng)域的FPGA應(yīng)用實例以及完整的設(shè)計源程序。本書可作為高等學(xué)校電子信息、計算機、自動化等專業(yè)的本科生教材，也可供從事電子系統(tǒng)設(shè)計的工程技術(shù)人員參考。

作者簡介

　　李莉：北京電子科技學(xué)院教授，長期從事EDA有可編程邏輯器件的研究與教學(xué)工作，“EDA技術(shù)”北京市精品課程負(fù)責(zé)人，北京市優(yōu)質(zhì)教學(xué)課件獎。

圖書目錄

目錄

第1章FPGA開發(fā)簡介

1.1可編程邏輯器件概述

1.2FPGA芯片

1.2.1FPGA框架結(jié)構(gòu)

1.2.2Intel公司的FPGA

1.3FPGA開發(fā)工具

1.4基于FPGA的開發(fā)流程

1.4.1FPGA設(shè)計方法概論

1.4.2典型FPGA開發(fā)流程

1.4.3FPGA的配置

1.4.4基于FPGA的SoC設(shè)計方法

第2章VHDL硬件描述語言

2.1程序基本結(jié)構(gòu)

2.2VHDL程序語法規(guī)則

2.3并行語句

2.4順序語句

2.5子程序及子程序調(diào)用語句

第3章Quartus Prime設(shè)計開發(fā)環(huán)境

3.1Quartus Prime概述

3.2Quartus Prime設(shè)計流程

3.2.1設(shè)計輸入

3.2.2設(shè)計處理

3.2.3波形仿真

3.2.4器件編程

3.3嵌入式邏輯分析儀使用

第4章基本電路的VHDL設(shè)計

4.1優(yōu)先編碼器

4.2數(shù)據(jù)選擇器

4.3組合邏輯電路與并行語句、進程語句的關(guān)系

4.4運算電路

4.5時鐘信號

4.6鎖存器和觸發(fā)器

4.7同步、異步信號描述

4.8同步電路設(shè)計原則

4.9計數(shù)器

4.10分頻電路

4.11寄存器

4.12狀態(tài)機

4.13動態(tài)掃描電路

第5章基于IP的設(shè)計

5.1IP核

5.2觸發(fā)器IP核的VHDL設(shè)計應(yīng)用

5.3存儲器IP核的VHDL設(shè)計應(yīng)用

5.4鎖相環(huán)IP核的VHDL設(shè)計應(yīng)用

5.5運算電路IP核的VHDL設(shè)計應(yīng)用

第6章人機交互接口設(shè)計

6.1鍵盤掃描電路的VHDL設(shè)計

6.1.1設(shè)計原理

6.1.2設(shè)計實現(xiàn)

6.1.3仿真驗證

6.2液晶驅(qū)動電路的VHDL設(shè)計

6.2.1設(shè)計原理

6.2.2設(shè)計實現(xiàn)

6.2.3仿真驗證

第7章數(shù)字信號處理

7.1差錯控制電路的VHDL設(shè)計(CRC校驗電路)

7.1.1設(shè)計原理

7.1.2校驗電路的VHDL實現(xiàn)

7.1.3仿真驗證

7.2濾波電路的VHDL設(shè)計

7.2.1設(shè)計原理

7.2.2FIR濾波電路的設(shè)計實現(xiàn)

7.2.3仿真驗證

7.3HDB3基帶信號編譯碼電路的VHDL設(shè)計

7.3.1設(shè)計原理

7.3.2設(shè)計實現(xiàn)

7.3.3仿真驗證

第8章密碼算法設(shè)計

8.1分組密碼算法的VHDL設(shè)計(SM4)

8.1.1SM4算法原理

8.1.2設(shè)計實現(xiàn)

8.1.3仿真驗證

8.2流密碼算法的VHDL設(shè)計(ZUC)

8.2.1ZUC算法原理

8.2.2設(shè)計實現(xiàn)

8.2.3仿真驗證

8.3HASH算法的VHDL設(shè)計(SM3)

8.3.1SM3算法原理

8.3.2設(shè)計實現(xiàn)

8.3.3仿真驗證

第9章基于Nios Ⅱ的SOPC系統(tǒng)開發(fā)

9.1簡介

9.1.1SOPC技術(shù)

9.1.2Nios Ⅱ嵌入式處理器

9.1.3Qsys開發(fā)工具

9.2SOPC硬件開發(fā)

9.2.1啟動Qsys

9.2.2添加Nios Ⅱ及外設(shè)IP模塊

9.2.3集成Nios Ⅱ系統(tǒng)至Quartus Prime

9.3SOPC軟件系統(tǒng)開發(fā)

9.3.1創(chuàng)建Nios Ⅱ工程

9.3.2設(shè)置工程的系統(tǒng)屬性

9.3.3程序編寫及編譯

9.3.4代碼調(diào)試及運行

第10章基于VHDL的FPGA設(shè)計實例

10.1多路選擇器

10.2寄存器

10.3移位寄存器

10.4計數(shù)器

10.5分頻器

10.6元件例化

10.7狀態(tài)機1

10.8狀態(tài)機2

10.9DES算法S盒

10.10DES算法初始置換IP

10.11十六進制數(shù)的共陰極7段數(shù)碼顯示譯碼器

10.12七人表決器的設(shè)計

10.13動態(tài)掃描顯示電路

10.14四人搶答器的設(shè)計

10.15偽隨機數(shù)產(chǎn)生器

10.16彩燈控制器1

10.17彩燈控制器2

10.18彩色LED點陣顯示電路設(shè)計

10.19計算器設(shè)計

10.20序列檢測器

10.21自動售貨機

10.22直流電機轉(zhuǎn)速控制電路

10.23籃球競賽30秒計時器

10.24電梯控制器

附錄1DES算法的S盒

附錄2VHDL保留字

參考文獻