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EDA技術(shù)與VHDL實(shí)用教程(第2版)

EDA技術(shù)與VHDL實(shí)用教程(第2版)

定 價(jià):¥25.70

作 者: 廖超平 編
出版社: 高等教育出版社
叢編項(xiàng): "十二五"職業(yè)教育國(guó)家規(guī)劃教材
標(biāo) 簽: 大中專教材教輔 高職高專教材

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ISBN: 9787040395440 出版時(shí)間: 2014-08-01 包裝: 平裝
開(kāi)本: 16開(kāi) 頁(yè)數(shù): 245 字?jǐn)?shù):  

內(nèi)容簡(jiǎn)介

  《EDA技術(shù)與VHDL實(shí)用教程(第2版)/“十二五”職業(yè)教育國(guó)家規(guī)劃教材》是“十二五”職業(yè)教育國(guó)家規(guī)劃教材?!禘DA技術(shù)與VHDL實(shí)用教程(第2版)/“十二五”職業(yè)教育國(guó)家規(guī)劃教材》的FPCA/CPLD開(kāi)發(fā)軟件選用國(guó)內(nèi)應(yīng)用廣泛的Altera的升級(jí)產(chǎn)品QuartusⅡ,硬件描述語(yǔ)言選用目前國(guó)際上常用的,并且在國(guó)內(nèi)資料較多的VHDL。對(duì)于QuartusⅡ,《EDA技術(shù)與VHDL實(shí)用教程(第2版)/“十二五”職業(yè)教育國(guó)家規(guī)劃教材》重點(diǎn)介紹其原理圖輸入設(shè)計(jì)法流程、VHDL輸入設(shè)計(jì)法流程、運(yùn)用QuartusⅡ進(jìn)行設(shè)計(jì)文件的編輯、編譯、仿真及器件編程等內(nèi)容。對(duì)于VHDL語(yǔ)言,則重點(diǎn)介紹VHDL語(yǔ)句與程序結(jié)構(gòu)、語(yǔ)法法則和設(shè)計(jì)流程等。在介紹VHDL時(shí),總結(jié)了以往高職程序設(shè)計(jì)教學(xué)的經(jīng)驗(yàn),采用分析一總結(jié)一設(shè)計(jì)的吸收一消化一再創(chuàng)新的教學(xué)方法,即引導(dǎo)學(xué)生先通過(guò)分析現(xiàn)有的程序,從中總結(jié)出規(guī)律或得到一定啟發(fā)后再進(jìn)行編寫(xiě)自己的新的程序?!禘DA技術(shù)與VHDL實(shí)用教程(第2版)/“十二五”職業(yè)教育國(guó)家規(guī)劃教材》可作為高等職業(yè)院校、高等??茖W(xué)校、成人高校、民辦高校及本科院校舉辦的二級(jí)職業(yè)技術(shù)學(xué)院電子信息工程技術(shù)專業(yè)、應(yīng)用電子技術(shù)專業(yè)及相關(guān)專業(yè)的教學(xué)用書(shū),也適用于五年制高職、中職相關(guān)專業(yè),并可作為社會(huì)從業(yè)人士的業(yè)務(wù)參考書(shū)及培訓(xùn)用書(shū)。

作者簡(jiǎn)介

暫缺《EDA技術(shù)與VHDL實(shí)用教程(第2版)》作者簡(jiǎn)介

圖書(shū)目錄

第1章 EDA技術(shù)概述
1.1 EDA的歷史及主要內(nèi)容
1.2 可編程邏輯器件
1.3 面向FPGA/CPLD的EDA設(shè)計(jì)流程
本章小結(jié)
本章習(xí)題
第2章 QuartusⅡ原理圖輸入設(shè)計(jì)法入門
2.1 QuartusⅡ原理圖輸入法
2.2 QuartusⅡ器件編程
本章小結(jié)
本章習(xí)題
實(shí)訓(xùn)項(xiàng)目
第3章 QuartusⅡ原理圖輸入法深入
3.1 原理圖輸入法中MAX+ plusⅡ老式宏函數(shù)的應(yīng)用
3.2 原理圖輸入法中LPM函數(shù)的應(yīng)用
3.3 原理圖輸入法中的層次化設(shè)計(jì)
本章小結(jié)
本章習(xí)題
實(shí)訓(xùn)項(xiàng)目
第4章 VHDL設(shè)計(jì)入門
4.1 QuartusⅡ的HDL輸入法
4.2 VHDL程序的基本結(jié)構(gòu)
4.3 VHDL程序的順序結(jié)構(gòu)
4.4 VHDL程序的并行結(jié)構(gòu)
4.5 VHDL程序的語(yǔ)言要素總結(jié)
本章小結(jié)
本章習(xí)題
實(shí)訓(xùn)項(xiàng)目
第5章 VHDL設(shè)計(jì)深入
5.1 深入VHDL程序結(jié)構(gòu)
5.2 VHDL設(shè)計(jì)中LPM函數(shù)的應(yīng)用
5.3 VHDL層次化文件設(shè)計(jì)
本章小結(jié)
本章習(xí)題
實(shí)訓(xùn)項(xiàng)目
第6章 綜合設(shè)計(jì)項(xiàng)目
6.1 使用LCD顯示的音樂(lè)電路設(shè)計(jì)
6.2 基于FPGA的LCD顯示的信號(hào)發(fā)生器設(shè)計(jì)
本章小結(jié)
參考文獻(xiàn)

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