數(shù)字邏輯基礎

第1章邏輯代數(shù)基礎
§1.1邏輯代數(shù)概述
1.1.1邏輯變量和邏輯函數(shù)
1.1.2基本邏輯運算
1.1.3常用的復合邏輯運算
1.1.4邏輯圖
§1.2邏輯代數(shù)的基本定理
1.2.1基本公式
1.2.2其他常用邏輯恒等式
1.2.3基本邏輯定理
§1.3邏輯函數(shù)的標準表達式和卡諾圖
1.3.1邏輯函數(shù)的兩種標準表達形式
1.3.2兩種邏輯函數(shù)標準表達式之間的相互關系
1.3.3將邏輯函數(shù)按照標準形式展開
1.3.4邏輯函數(shù)的卡諾圖表示
§1.4邏輯函數(shù)的化簡
1.4.1代數(shù)法化簡
1.4.2卡諾圖化簡法
1.4.3利用卡諾圖運算來進行邏輯化簡
1.4.4不完全確定的邏輯函數(shù)的化簡
1.4.5使用異或函數(shù)的卡諾圖化簡
1.4.6多輸出邏輯函數(shù)的化簡
1.4.7影射變量卡諾圖
1.4.8邏輯函數(shù)的計算機化簡
本章概要
思考題和習題
第2章組合邏輯電路
§2.1組合邏輯電路分析
2.1.1組合邏輯電路分析的一般過程
2.1.2常用的組合邏輯電路模塊分析
§2.2組合邏輯電路設計
2.2.1組合邏輯電路設計的一般過程
2.2.2應用組合邏輯電路模塊構(gòu)成組合電路
2.2.3數(shù)字運算電路設計
§2.3數(shù)字集成電路的電氣特性
2.3.1晶體管和場效應管的開關作用
2.3.2數(shù)字集成電路的靜態(tài)特性
2.3.3數(shù)字集成電路的動態(tài)特性
2.3.4三態(tài)輸出電路和開路輸出電路
§2.4組合邏輯電路中的競爭冒險
2.4.1競爭冒險現(xiàn)象及其成因
2.4.2檢查競爭冒險現(xiàn)象的方法
2.4.3消除競爭冒險現(xiàn)象的方法
本章概要
思考題和習題
第3章觸發(fā)器及其基本應用電路
§3.1觸發(fā)器的基本邏輯類型及其狀態(tài)的描寫
3.1.1RS觸發(fā)器
3.1.2JK觸發(fā)器
3.1.3D觸發(fā)器
3.1.4T觸發(fā)器
3.1.54種觸發(fā)器的相互轉(zhuǎn)換
§3.2觸發(fā)器的電路結(jié)構(gòu)與工作原理
3.2.1D鎖存器
3.2.2主從觸發(fā)器
3.2.3邊沿觸發(fā)器
3.2.4邊沿觸發(fā)器的動態(tài)特性
§3.3觸發(fā)器的基本應用
3.3.1簡單計數(shù)器
3.3.2寄存器
本章概要
思考題和習題
第4章同步時序電路
§4.1時序電路的描述
4.1.1兩種基本模型
4.1.2狀態(tài)轉(zhuǎn)換圖和狀態(tài)轉(zhuǎn)換表
4.1.3兩種基本模型的相互轉(zhuǎn)換
§4.2同步時序電路的分析
4.2.1同步時序電路分析的一般過程
4.2.2常用同步時序電路分析
§4.3同步時序電路的設計
4.3.1同步時序電路設計的一般過程
4.3.2帶有冗余狀態(tài)的同步時序電路設計
4.3.3用算法狀態(tài)機方法設計同步時序電路
4.3.4同步時序電路設計中的狀態(tài)分配問題
§4.4時序電路的狀態(tài)化簡
4.4.1完全描述狀態(tài)表的等價與化簡
4.4.2不完全描述狀態(tài)表的化簡
本章概要
思考題和習題
第5章異步時序電路
§5.1基本型異步時序電路的分析
5.1.1基本型異步時序電路的結(jié)構(gòu)及其描述
5.1.2基本型異步時序電路的一般分析過程
§5.2基本型異步時序電路中的競爭與冒險
5.2.1臨界競爭與非臨界競爭
5.2.2臨界競爭的判別
5.2.3臨界競爭的消除
5.2.4基本型異步時序電路中的冒險
§5.3基本型異步時序電路設計
§5.4脈沖型異步時序電路的分析與設計
5.4.1脈沖型異步時序電路的分析
5.4.2脈沖型異步時序電路的設計
本章概要
思考題和習題
第6章可編程邏輯器件與數(shù)字系統(tǒng)設計初步
§6.1可編程邏輯器件的基本結(jié)構(gòu)
6.1.1基于乘積項的可編程邏輯器件
6.1.2基于查找表的可編程邏輯器件
6.1.3可編程邏輯器件中的“熔絲”
6.1.4可編程邏輯器件的編程過程
§6.2數(shù)字系統(tǒng)設計初步
6.2.1數(shù)字系統(tǒng)
6.2.2數(shù)字系統(tǒng)設計的一般過程
6.2.3用可編程邏輯器件進行數(shù)字系統(tǒng)設計
本章概要
思考題和習題
附錄
附錄1數(shù)制與代碼
附錄2《電器圖用圖形符號——二進制邏輯單元》（GB4728.12-85）
附錄3集成邏輯門電路的內(nèi)部結(jié)構(gòu)簡介
附錄4VHDL的對象.運算符和關鍵字
參考文獻