ISP系統(tǒng)設(shè)計(jì)技術(shù)入門(mén)與應(yīng)用

　　本書(shū)介紹了ispLSI系列在系統(tǒng)可編程邏輯器件和ispPAC系列模擬在系統(tǒng)可編程器件的內(nèi)部結(jié)構(gòu)和工作原理，用于數(shù)字邏輯電路設(shè)計(jì)的硬件描述語(yǔ)言ABEL-HDL、VHDL和Verilog-HDL，以及在系統(tǒng)可編程邏輯器件的開(kāi)發(fā)系統(tǒng)ispDesignEXPERT和模擬在系統(tǒng)可編程器件的開(kāi)發(fā)系統(tǒng)PAC-Design中的使用方法，最后介紹了實(shí)現(xiàn)具有一定應(yīng)用價(jià)值的電子系統(tǒng)的設(shè)計(jì)方法和實(shí)例。本書(shū)可以作為從事電子產(chǎn)品開(kāi)發(fā)和生產(chǎn)的工程技術(shù)人員學(xué)習(xí)和開(kāi)發(fā)在系統(tǒng)可編程集成電路原理和應(yīng)用技術(shù)的參考書(shū)，也可以作為大專(zhuān)院校電子工程類(lèi)專(zhuān)業(yè)開(kāi)設(shè)實(shí)驗(yàn)和數(shù)字系統(tǒng)設(shè)計(jì)課程的教學(xué)參考書(shū)?！禘DA技術(shù)叢書(shū)》編委會(huì)名單主任：邵國(guó)培（解放軍電子工程學(xué)院副院長(zhǎng)、教授、博導(dǎo)）副主任：陸伯雄（電子工業(yè)出版社高級(jí)編輯）黃正瑾（東南大學(xué)電工電子實(shí)驗(yàn)中心主任、教授）主編：李東生（解放軍電子工程學(xué)院電子技術(shù)實(shí)驗(yàn)中心副主任、副教授）編委：李輝（中國(guó)科技大學(xué)高級(jí)工程師）鄭步生（南京航空航天大學(xué)EDA實(shí)驗(yàn)中心副主任、副教授）龔建榮（南京郵電學(xué)院信息工程系副主任、副教授）張勇（解放軍電子工程學(xué)院高級(jí)工程師）序言眾所周知，電子系統(tǒng)的集成化，不僅可使系統(tǒng)的體積小、重量輕且功耗低，更重要的是可使系統(tǒng)的可靠性大大提高。因此自集成電路問(wèn)世以來(lái)，集成規(guī)模便以10倍/6年的速度增長(zhǎng)。從20世紀(jì)90年代初以來(lái)，電子系統(tǒng)日趨數(shù)字化、復(fù)雜化和大規(guī)模集成化。由于個(gè)人電腦、無(wú)繩電話和高速數(shù)據(jù)傳輸設(shè)備的發(fā)展需求，電子廠商們?cè)郊悠惹械刈非箅娮赢a(chǎn)品的高功能、優(yōu)品質(zhì)、低成本、微功耗和微小封裝尺寸。為達(dá)此目標(biāo)，必須采用少量的IC器件和面積盡可能小的PCB板研制高集成化的復(fù)雜系統(tǒng)，這些要求進(jìn)一步促進(jìn)集成工藝的發(fā)展。1999年，以0.18微米工藝為基礎(chǔ)的百萬(wàn)門(mén)器件已經(jīng)出現(xiàn)，預(yù)計(jì)在2002年和2005年，集成工藝將分別達(dá)到0.13微米和0.1微米。深亞微米半導(dǎo)體工藝、B表面安裝技術(shù)的發(fā)展又支持了產(chǎn)品的集成化程度的進(jìn)步，使電子產(chǎn)品進(jìn)入了片上系統(tǒng)（SOC，SystemOnChip）時(shí)代。所謂片上系統(tǒng)的設(shè)計(jì)，是將電路設(shè)計(jì)、系統(tǒng)設(shè)計(jì)、硬件設(shè)計(jì)、軟件設(shè)計(jì)和體系結(jié)構(gòu)設(shè)計(jì)集合于一體的設(shè)計(jì)。這樣復(fù)雜的設(shè)計(jì)通常需要很多人、經(jīng)過(guò)多年研究開(kāi)發(fā)方能實(shí)現(xiàn)，不依靠計(jì)算機(jī)的幫助是無(wú)法在短期完成的。圖0-1產(chǎn)品的利潤(rùn)與其上市時(shí)間的關(guān)系另一方面，電子產(chǎn)品設(shè)計(jì)周期短和上市快也是電子廠商們堅(jiān)持不懈的追求。圖0-1表明了產(chǎn)品上市時(shí)間與其利潤(rùn)之間的關(guān)系。一個(gè)產(chǎn)品從開(kāi)始上市到其從市場(chǎng)上被淘汰為止，其銷(xiāo)售情況是一個(gè)三角形。這個(gè)三角形的面積便是此產(chǎn)品的總的利潤(rùn)，如果產(chǎn)品上市晚了，如圖中t2時(shí)間較t1時(shí)間晚了時(shí)間Δ，則從t2開(kāi)始的三角形的面積比從t1開(kāi)始的三角形的面積將小得多，也就是所獲得的總利潤(rùn)將小得多。這說(shuō)明，一個(gè)企業(yè)如果能夠比其競(jìng)爭(zhēng)對(duì)手更快地推出新產(chǎn)品，更快地對(duì)市場(chǎng)作出反應(yīng)，即可獲取更大的市場(chǎng)份額和更大的利潤(rùn)。電子設(shè)計(jì)自動(dòng)化（EDAElectronicsDesignAutomation），即用計(jì)算機(jī)幫助設(shè)計(jì)人員完成繁瑣的設(shè)計(jì)工作，是解決以上兩個(gè)問(wèn)題的惟一途徑。電子設(shè)計(jì)自動(dòng)化在不同的時(shí)期有不同的內(nèi)容。在20世紀(jì)70年代表現(xiàn)為計(jì)算機(jī)輔助設(shè)計(jì)（CAD），即將電子設(shè)計(jì)中涉及到的許多計(jì)算用計(jì)算機(jī)程序?qū)崿F(xiàn)。在20世紀(jì)80年代表現(xiàn)為計(jì)算機(jī)輔助工程（CAE），主要體現(xiàn)在一些繪圖軟件出現(xiàn)，減輕了設(shè)計(jì)人員的勞動(dòng)。從20世紀(jì)80年代末開(kāi)始，設(shè)計(jì)復(fù)雜程度越來(lái)越高，EDA的主要內(nèi)容逐步轉(zhuǎn)變?yōu)殡娮酉到y(tǒng)設(shè)計(jì)自動(dòng)化（ESDA）?，F(xiàn)在數(shù)字系統(tǒng)的EDA可以直接根據(jù)設(shè)計(jì)要求，以自頂至底的方式設(shè)計(jì)，并相應(yīng)地完成系統(tǒng)描述、仿真、集成和驗(yàn)證等環(huán)節(jié)，直到最后生成所需要的器件。在以上過(guò)程中，除系統(tǒng)級(jí)設(shè)計(jì)和行為級(jí)描述及對(duì)功能的描述以外均可由計(jì)算機(jī)自動(dòng)完成。也就是說(shuō)，設(shè)計(jì)人員借助開(kāi)發(fā)軟件的幫助，可以將設(shè)計(jì)過(guò)程中的許多細(xì)節(jié)問(wèn)題拋開(kāi)，而將注意力集中在產(chǎn)品的總體開(kāi)發(fā)上。這樣大大減輕了工作人員的工作量，提高了設(shè)計(jì)效率，減少了以往復(fù)雜的工序，縮短了開(kāi)發(fā)周期，實(shí)現(xiàn)了真正意義上的電子設(shè)計(jì)自動(dòng)化。這個(gè)變化是伴隨著片上系統(tǒng)的設(shè)計(jì)出現(xiàn)的，因此有人將EDA轉(zhuǎn)向片上系統(tǒng)看作是一次關(guān)于系統(tǒng)設(shè)計(jì)的革命。對(duì)電子系統(tǒng)設(shè)計(jì)自動(dòng)化而言，現(xiàn)代設(shè)計(jì)方法和現(xiàn)代測(cè)試方法是至關(guān)重要的。當(dāng)前，EDA包含單片機(jī)、ASIC（專(zhuān)用集成電路）和DSP（數(shù)字信號(hào)處理）等主要方向。無(wú)論哪一種方向，都需要一個(gè)功能齊全、處理方法先進(jìn)、使用方便和高效的開(kāi)發(fā)系統(tǒng)。目前世界上一些大型EDA軟件公司已開(kāi)發(fā)了一些著名的軟件，如orCAD、Cadence、PSPICE（以及由其衍生出的軟件ElectronicWorkBench）和Viewlogic（現(xiàn)在為INNOVEDA）等，各大半導(dǎo)體器件公司為了推動(dòng)其生產(chǎn)的芯片的應(yīng)用，也推出了一些開(kāi)發(fā)軟件，如Lattice公司的Synario，Altera公司的MaxPlusII，Xilinx公司的Fundation等。隨著新器件和新工藝的出現(xiàn)，這些開(kāi)發(fā)軟件也在不斷更新或升級(jí)，如Lattice公司的Synario和Altera公司的MaxPlusII將分別被Expert和Quatues所代替。軟件系統(tǒng)變化如此之快，使得幾年前出版的有關(guān)書(shū)籍，特別是教材，已經(jīng)不能完全適用于現(xiàn)在的器件和開(kāi)發(fā)系統(tǒng)的現(xiàn)狀。每個(gè)開(kāi)發(fā)系統(tǒng)都有自己的描述語(yǔ)言，為了便于各系統(tǒng)之間的兼容，IEEE公布了幾種標(biāo)準(zhǔn)語(yǔ)言，最常用的有VHDL和Verilog。VHDL是美國(guó)國(guó)防部于20世紀(jì)80年代初推出，其全稱是VeryHighSpeedIntegratedCircuitHDL，即超高速集成電路硬件描述語(yǔ)言，該語(yǔ)言曾于1987年和1993年兩次被定為IEEE的標(biāo)準(zhǔn)；Verilog語(yǔ)言原是美國(guó)GatewayDesignAutomation公司于20世紀(jì)80年代開(kāi)發(fā)的邏輯模擬器Verilog-XL所使用的硬件描述語(yǔ)言。1989年Cadence公司收購(gòu)該公司后于1990年公開(kāi)以VerilogHDL名稱發(fā)表，并成立了OVI（OpenVerilogInternational）組織負(fù)責(zé)該語(yǔ)言的發(fā)？?。由釉嵜语丫墦吓越性，各大皻枥^迤骷痙追撞捎盟魑⒈竟靜返墓ぞ?。UEEE也于1995年將其定為協(xié)會(huì)的標(biāo)準(zhǔn)，即IEEE1364-1995，這兩種語(yǔ)言已成為從事EDA的電子工程師必須掌握的工具。與開(kāi)發(fā)工具同樣重要的是器件，就ASIC方向而言，所使用的集成方式有全定制、半定制和可編程邏輯器件等。可編程邏輯器件（PLD）與全定制和半定制不同，它按標(biāo)準(zhǔn)器件生產(chǎn)，芯片工廠因此可以獲得規(guī)模生產(chǎn)效益。而用戶則可以通過(guò)編程PLD器件以實(shí)現(xiàn)特殊的應(yīng)用，從而獲得ASIC產(chǎn)品的功能。換言之，PLD將控制功能交給用戶，用戶在用PLD器件研發(fā)產(chǎn)品時(shí)即獲得了這種控制功能。CPLD和FPGA較全定制和半定制方法具有更多的靈活性——既適用于短研制周期、小批量產(chǎn)品開(kāi)發(fā)，也可用于大批量產(chǎn)品的樣品研制，且項(xiàng)目開(kāi)發(fā)前期費(fèi)用低，開(kāi)發(fā)時(shí)間短，有利于新產(chǎn)品占領(lǐng)市場(chǎng)，是目前ASIC設(shè)計(jì)所使用的最主要的方法。有人認(rèn)為，可編程邏輯器件（PLD）不僅近年來(lái)受到系統(tǒng)設(shè)計(jì)者的青睞，而且在半導(dǎo)體領(lǐng)域中呈現(xiàn)出一支獨(dú)秀的增長(zhǎng)態(tài)勢(shì)，成為系統(tǒng)級(jí)平臺(tái)設(shè)計(jì)的首選。隨著PLD器件向更高速、更高集成度、更強(qiáng)功能和更靈活的方向發(fā)展，將來(lái)也仍然是掩膜式專(zhuān)用集成電路（全定制與半定制方式）有力的競(jìng)爭(zhēng)者。CPLD和FPGA普及的另一個(gè)重要原因是IP（知識(shí)產(chǎn)權(quán)）越來(lái)越被高度重視，帶有IP內(nèi)核的功能塊在ASIC設(shè)計(jì)平臺(tái)上的應(yīng)用日益廣泛。越來(lái)越多的設(shè)計(jì)人員，采用設(shè)計(jì)重用，將系統(tǒng)設(shè)計(jì)模塊化，為設(shè)計(jì)帶來(lái)了快捷和方便。并可以使每個(gè)設(shè)計(jì)人員充分利用軟件代碼，提高開(kāi)發(fā)效率，減少應(yīng)市時(shí)間，降低研發(fā)費(fèi)用，縮短研發(fā)周期，降低風(fēng)險(xiǎn)。這是研究EDA技術(shù)必須關(guān)注的問(wèn)題。本叢書(shū)的宗旨為讀者介紹當(dāng)前我國(guó)最流行的幾種EDA軟件以及CPLD和FPGA的原理和應(yīng)用，其中包括通用設(shè)計(jì)軟件Protel，電路設(shè)計(jì)軟件OrCAD，電路設(shè)計(jì)軟件Multisim（原ElectronicWorkbench6.0以上版本），系統(tǒng)模擬軟件Systemview和CPLD開(kāi)發(fā)軟件MaxPlusII（Quatues），F(xiàn)PGA開(kāi)發(fā)軟件Fundation，ispLSI開(kāi)發(fā)軟件Expert（Synario）等。在介紹這些EDA軟件時(shí)，既不像大部分教科書(shū)那樣只簡(jiǎn)要介紹它們的基本規(guī)則和有關(guān)器件的基本原理（這種介紹只適用于對(duì)初學(xué)者的訓(xùn)練，對(duì)生產(chǎn)科研的實(shí)際應(yīng)用則不能完全適應(yīng)）；也不像使用手冊(cè)那樣洋洋大篇，難以快速掌握；更不像公司宣傳用的資料那樣過(guò)多地介紹自己的產(chǎn)品，缺乏可讀性。而是從教會(huì)讀者基本使用方法開(kāi)始，通過(guò)各種實(shí)例，由淺入深地介紹其應(yīng)用（在3個(gè)介紹開(kāi)發(fā)軟件的著作中還按以用為本的原則對(duì)有關(guān)的器件和VHDL語(yǔ)言作了必要的闡述）。叢書(shū)作者都是有一定教學(xué)和科研實(shí)踐經(jīng)驗(yàn)的教師，清楚如何啟發(fā)讀者快速地掌握軟件的精要，各本書(shū)中也不同程度地反映了作者科研實(shí)踐中的寶貴經(jīng)驗(yàn)，其中很多是在教科書(shū)和使用手冊(cè)中見(jiàn)不到的（例如對(duì)VHDL的應(yīng)用，教科書(shū)上介紹的只是通用的規(guī)則，本叢書(shū)則是介紹針對(duì)某個(gè)開(kāi)發(fā)系統(tǒng)中適用的規(guī)則）。尤其介紹了若干較大型的設(shè)計(jì)實(shí)例，直至對(duì)IP的簡(jiǎn)單應(yīng)用。讀者可以從入門(mén)開(kāi)始，經(jīng)過(guò)由淺入深的訓(xùn)練，逐步達(dá)到精通的境界。黃正瑾于東南大學(xué)2001年12月前言隨著計(jì)算機(jī)和大規(guī)模集成電路制造技術(shù)的迅速發(fā)展，采用普通的小規(guī)模數(shù)字邏輯集成電路，如74系列的TTL通用數(shù)字邏輯集成電路，已經(jīng)不能夠滿足現(xiàn)代數(shù)字系統(tǒng)設(shè)計(jì)的要求。因此，在現(xiàn)代的電子產(chǎn)品和復(fù)雜的數(shù)字邏輯系統(tǒng)中，一般都采用了各種類(lèi)型的大規(guī)模集成電路。高密度在系統(tǒng)可編程ispLSI（In-SystemProgammableLargeScaleIntegration）邏輯器件是眾多大規(guī)模復(fù)雜可編程邏輯集成電路中的一種，其先進(jìn)的設(shè)計(jì)思想和靈活的開(kāi)發(fā)工具，使原來(lái)感到復(fù)雜的數(shù)字邏輯系統(tǒng)的設(shè)計(jì)變得輕松和簡(jiǎn)單了?！癐SP”（在系統(tǒng)可編程）是指用戶為了修改邏輯設(shè)計(jì)或重構(gòu)數(shù)字邏輯系統(tǒng)，而在已經(jīng)設(shè)計(jì)和制作后的電路板上，直接在線編程和反復(fù)修改在系統(tǒng)可編程邏輯器件

暫缺《ISP系統(tǒng)設(shè)計(jì)技術(shù)入門(mén)與應(yīng)用》作者簡(jiǎn)介